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https://github.com/riscv-software-src/riscv-isa-sim.git
synced 2025-10-14 02:07:30 +08:00
Merge pull request #2099 from riscv-software-src/vector-tests
test: add basic random tests for V extension
This commit is contained in:
@@ -14,5 +14,5 @@ CONFIGDIR=$(dirname "$CONFIG")
|
||||
base=$(basename "$CONFIG" .yaml)
|
||||
elf="$base".elf
|
||||
./llvm-snippy "$CONFIG" -o "$elf" --seed 1 -mtriple="$TRIPLE" -march="$ARCH" -riscv-disable-misaligned-access
|
||||
riscv64-linux-gnu-gcc -O0 -march="$ARCH" -mabi="$ABI" -T "$elf".ld -T "$CONFIGDIR"/linker-entry.ld "$elf" "$BOOTCODE" -nostdlib -static -o "$RESULT"
|
||||
riscv64-linux-gnu-gcc -O0 -march="$ARCH" -mabi="$ABI" -T "$elf".ld -T "$CONFIGDIR"/linker-entry.ld "$elf" "$BOOTCODE" -nostdlib -static -o "$RESULT" -Wl,--build-id=none
|
||||
|
||||
|
@@ -35,3 +35,5 @@ generate_script=`git rev-parse --show-toplevel`/ci-tests/generate-snippy-test.sh
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||||
"$generate_script" "$CONFIGDIR"/single-fp.yaml "$RESULTDIR"/float32.elf \
|
||||
"$CONFIGDIR"/boot-code-f.s riscv32-unknown-elf rv32if_zicsr ilp32f
|
||||
|
||||
"$generate_script" "$CONFIGDIR"/vector.yaml "$RESULTDIR"/vector64.elf \
|
||||
"$CONFIGDIR"/boot-code-vf.s riscv64-unknown-elf rv64gcv lp64d
|
||||
|
@@ -8,7 +8,7 @@ SPIKE_PATH="$2"
|
||||
error=0
|
||||
for testfile in "$TESTDIR"/*; do
|
||||
bitness=$(basename "$testfile" .elf | grep -o "[0-9]\+")
|
||||
if ! timeout --foreground 5s "$SPIKE_PATH" -l --log-commits --isa rv"$bitness"ifdc_zicsr "$testfile"
|
||||
if ! timeout --foreground 5s "$SPIKE_PATH" -l --log-commits --isa rv"$bitness"ifdcv_zicsr "$testfile"
|
||||
then
|
||||
echo "TIMEOUT: $testfile"
|
||||
error=1
|
||||
|
45
ci-tests/snippy-tests/boot-code-vf.s
Normal file
45
ci-tests/snippy-tests/boot-code-vf.s
Normal file
@@ -0,0 +1,45 @@
|
||||
.option norvc
|
||||
|
||||
.global _entry
|
||||
.global fromhost
|
||||
.global tohost
|
||||
|
||||
.text
|
||||
_entry:
|
||||
la t0, exception_handler
|
||||
csrw mtvec, t0
|
||||
csrr t1, mstatus
|
||||
# Setting bit number 9 (mstatus.VS)
|
||||
li t2, 1
|
||||
slli t2, t2, 9
|
||||
or t1, t1, t2
|
||||
# Setting bit number 13 (mstatus.FS)
|
||||
li t3, 1
|
||||
slli t3, t3, 13
|
||||
or t1, t1, t3
|
||||
csrw mstatus, t1
|
||||
la t0, SNIPPY_ENTRY
|
||||
jalr t0
|
||||
|
||||
exception_handler:
|
||||
csrr x10, mcause
|
||||
# In case of breakpoint (Interrupt = 0, Exception code = 3) we finalize.
|
||||
# Otherwise it's not the expected behavior and we go into an infinite loop.
|
||||
li x11, 3
|
||||
beq x10, x11, exit
|
||||
j infinite_loop
|
||||
|
||||
exit:
|
||||
li ra, 1
|
||||
la sp, tohost
|
||||
sd ra, 0(sp)
|
||||
|
||||
infinite_loop:
|
||||
j infinite_loop
|
||||
|
||||
.balign 64
|
||||
tohost:
|
||||
.8byte 0x0
|
||||
.balign 64
|
||||
fromhost:
|
||||
.8byte 0x0
|
717
ci-tests/snippy-tests/vector.yaml
Normal file
717
ci-tests/snippy-tests/vector.yaml
Normal file
@@ -0,0 +1,717 @@
|
||||
options:
|
||||
num-instrs: 2000
|
||||
entry-point: SNIPPY_ENTRY
|
||||
model-plugin: None
|
||||
|
||||
sections:
|
||||
- name: 0
|
||||
VMA: 0x80000000
|
||||
SIZE: 0x10000
|
||||
LMA: 0x80000000
|
||||
ACCESS: r
|
||||
- name: 1
|
||||
VMA: 0x80020000
|
||||
SIZE: 0x20000
|
||||
LMA: 0x80020000
|
||||
ACCESS: rx
|
||||
- name: 2
|
||||
VMA: 0x80040000
|
||||
SIZE: 0x10000
|
||||
LMA: 0x80040000
|
||||
ACCESS: rw
|
||||
- name: stack
|
||||
VMA: 0x80050000
|
||||
SIZE: 0x10000
|
||||
LMA: 0x80050000
|
||||
ACCESS: rw
|
||||
|
||||
riscv-vector-unit:
|
||||
mode-change-bias:
|
||||
P: 0.2
|
||||
mode-distribution:
|
||||
VM:
|
||||
- [all_ones, 2.0]
|
||||
- [any_legal, 1.0]
|
||||
VL:
|
||||
- [max_encodable, 2.0]
|
||||
- [any_legal, 1.0]
|
||||
VXRM:
|
||||
rnu: 1.0
|
||||
rne: 1.0
|
||||
rdn: 1.0
|
||||
ron: 1.0
|
||||
VTYPE:
|
||||
SEW:
|
||||
sew_8: 1.0
|
||||
sew_16: 1.0
|
||||
sew_32: 1.0
|
||||
sew_64: 1.0
|
||||
LMUL:
|
||||
m1: 1.0
|
||||
m2: 1.0
|
||||
m4: 1.0
|
||||
m8: 1.0
|
||||
mf2: 1.0
|
||||
mf4: 1.0
|
||||
mf8: 1.0
|
||||
VMA:
|
||||
mu: 1.0
|
||||
ma: 1.0
|
||||
VTA:
|
||||
tu: 1.0
|
||||
ta: 1.0
|
||||
|
||||
histogram:
|
||||
- ["ADD", 1.0]
|
||||
- ["ADDI", 1.0]
|
||||
- ["AND", 1.0]
|
||||
- ["ANDI", 1.0]
|
||||
- ["AUIPC", 1.0]
|
||||
- ["BEQ", 5.0]
|
||||
- ["BGE", 5.0]
|
||||
- ["BGEU", 5.0]
|
||||
- ["BLT", 5.0]
|
||||
- ["BLTU", 5.0]
|
||||
- ["BNE", 5.0]
|
||||
- ["L[BHWD][U]?", 5.0]
|
||||
- ["S[BHWD]", 5.0]
|
||||
- ["LUI", 1.0]
|
||||
- ["OR", 1.0]
|
||||
- ["ORI", 1.0]
|
||||
- ["SLL", 1.0]
|
||||
- ["SLLI", 1.0]
|
||||
- ["SLT", 1.0]
|
||||
- ["SLTI", 1.0]
|
||||
- ["SLTIU", 1.0]
|
||||
- ["SLTU", 1.0]
|
||||
- ["SRA", 1.0]
|
||||
- ["SRAI", 1.0]
|
||||
- ["SRL", 1.0]
|
||||
- ["SRLI", 1.0]
|
||||
- ["SUB", 1.0]
|
||||
- ["XOR", 1.0]
|
||||
- ["XORI", 1.0]
|
||||
- ["VAADDU_VV", 1.0]
|
||||
- ["VAADDU_VX", 1.0]
|
||||
- ["VAADD_VV", 1.0]
|
||||
- ["VAADD_VX", 1.0]
|
||||
- ["VADC_VIM", 1.0]
|
||||
- ["VADC_VVM", 1.0]
|
||||
- ["VADC_VXM", 1.0]
|
||||
- ["VADD_VI", 1.0]
|
||||
- ["VADD_VV", 1.0]
|
||||
- ["VADD_VX", 1.0]
|
||||
- ["VAND_VI", 1.0]
|
||||
- ["VAND_VV", 1.0]
|
||||
- ["VAND_VX", 1.0]
|
||||
- ["VASUBU_VV", 1.0]
|
||||
- ["VASUBU_VX", 1.0]
|
||||
- ["VASUB_VV", 1.0]
|
||||
- ["VASUB_VX", 1.0]
|
||||
- ["VCOMPRESS_VM", 1.0]
|
||||
- ["VCPOP_M", 1.0]
|
||||
- ["VDIVU_VV", 1.0]
|
||||
- ["VDIVU_VX", 1.0]
|
||||
- ["VDIV_VV", 1.0]
|
||||
- ["VDIV_VX", 1.0]
|
||||
- ["VFADD_VF", 1.0]
|
||||
- ["VFADD_VV", 1.0]
|
||||
- ["VFCLASS_V", 1.0]
|
||||
- ["VFCVT_F_XU_V", 1.0]
|
||||
- ["VFCVT_F_X_V", 1.0]
|
||||
- ["VFCVT_RTZ_XU_F_V", 1.0]
|
||||
- ["VFCVT_RTZ_X_F_V", 1.0]
|
||||
- ["VFCVT_XU_F_V", 1.0]
|
||||
- ["VFCVT_X_F_V", 1.0]
|
||||
- ["VFDIV_VF", 1.0]
|
||||
- ["VFDIV_VV", 1.0]
|
||||
- ["VFIRST_M", 1.0]
|
||||
- ["VFMACC_VF", 1.0]
|
||||
- ["VFMACC_VV", 1.0]
|
||||
- ["VFMADD_VF", 1.0]
|
||||
- ["VFMADD_VV", 1.0]
|
||||
- ["VFMAX_VF", 1.0]
|
||||
- ["VFMAX_VV", 1.0]
|
||||
- ["VFMERGE_VFM", 1.0]
|
||||
- ["VFMIN_VF", 1.0]
|
||||
- ["VFMIN_VV", 1.0]
|
||||
- ["VFMSAC_VF", 1.0]
|
||||
- ["VFMSAC_VV", 1.0]
|
||||
- ["VFMSUB_VF", 1.0]
|
||||
- ["VFMSUB_VV", 1.0]
|
||||
- ["VFMUL_VF", 1.0]
|
||||
- ["VFMUL_VV", 1.0]
|
||||
- ["VFMV_F_S", 1.0]
|
||||
- ["VFMV_S_F", 1.0]
|
||||
- ["VFMV_V_F", 1.0]
|
||||
- ["VFNCVT_F_F_W", 1.0]
|
||||
- ["VFNCVT_F_XU_W", 1.0]
|
||||
- ["VFNCVT_F_X_W", 1.0]
|
||||
- ["VFNCVT_ROD_F_F_W", 1.0]
|
||||
- ["VFNCVT_RTZ_XU_F_W", 1.0]
|
||||
- ["VFNCVT_RTZ_X_F_W", 1.0]
|
||||
- ["VFNCVT_XU_F_W", 1.0]
|
||||
- ["VFNCVT_X_F_W", 1.0]
|
||||
- ["VFNMACC_VF", 1.0]
|
||||
- ["VFNMACC_VV", 1.0]
|
||||
- ["VFNMADD_VF", 1.0]
|
||||
- ["VFNMADD_VV", 1.0]
|
||||
- ["VFNMSAC_VF", 1.0]
|
||||
- ["VFNMSAC_VV", 1.0]
|
||||
- ["VFNMSUB_VF", 1.0]
|
||||
- ["VFNMSUB_VV", 1.0]
|
||||
- ["VFRDIV_VF", 1.0]
|
||||
- ["VFREC7_V", 1.0]
|
||||
- ["VFREDMAX_VS", 1.0]
|
||||
- ["VFREDMIN_VS", 1.0]
|
||||
- ["VFREDOSUM_VS", 1.0]
|
||||
- ["VFREDUSUM_VS", 1.0]
|
||||
- ["VFRSQRT7_V", 1.0]
|
||||
- ["VFRSUB_VF", 1.0]
|
||||
- ["VFSGNJN_VF", 1.0]
|
||||
- ["VFSGNJN_VV", 1.0]
|
||||
- ["VFSGNJX_VF", 1.0]
|
||||
- ["VFSGNJX_VV", 1.0]
|
||||
- ["VFSGNJ_VF", 1.0]
|
||||
- ["VFSGNJ_VV", 1.0]
|
||||
- ["VFSLIDE1DOWN_VF", 1.0]
|
||||
- ["VFSLIDE1UP_VF", 1.0]
|
||||
- ["VFSQRT_V", 1.0]
|
||||
- ["VFSUB_VF", 1.0]
|
||||
- ["VFSUB_VV", 1.0]
|
||||
- ["VFWADD_VF", 1.0]
|
||||
- ["VFWADD_VV", 1.0]
|
||||
- ["VFWADD_WF", 1.0]
|
||||
- ["VFWADD_WV", 1.0]
|
||||
- ["VFWCVT_F_F_V", 1.0]
|
||||
- ["VFWCVT_F_XU_V", 1.0]
|
||||
- ["VFWCVT_F_X_V", 1.0]
|
||||
- ["VFWCVT_RTZ_XU_F_V", 1.0]
|
||||
- ["VFWCVT_RTZ_X_F_V", 1.0]
|
||||
- ["VFWCVT_XU_F_V", 1.0]
|
||||
- ["VFWCVT_X_F_V", 1.0]
|
||||
- ["VFWMACC_VF", 1.0]
|
||||
- ["VFWMACC_VV", 1.0]
|
||||
- ["VFWMSAC_VF", 1.0]
|
||||
- ["VFWMSAC_VV", 1.0]
|
||||
- ["VFWMUL_VF", 1.0]
|
||||
- ["VFWMUL_VV", 1.0]
|
||||
- ["VFWNMACC_VF", 1.0]
|
||||
- ["VFWNMACC_VV", 1.0]
|
||||
- ["VFWNMSAC_VF", 1.0]
|
||||
- ["VFWNMSAC_VV", 1.0]
|
||||
- ["VFWREDOSUM_VS", 1.0]
|
||||
- ["VFWREDUSUM_VS", 1.0]
|
||||
- ["VFWSUB_VF", 1.0]
|
||||
- ["VFWSUB_VV", 1.0]
|
||||
- ["VFWSUB_WF", 1.0]
|
||||
- ["VFWSUB_WV", 1.0]
|
||||
- ["VID_V", 1.0]
|
||||
- ["VIOTA_M", 1.0]
|
||||
- ["VL1RE16_V", 1.0]
|
||||
- ["VL1RE32_V", 1.0]
|
||||
- ["VL1RE64_V", 1.0]
|
||||
- ["VL1RE8_V", 1.0]
|
||||
- ["VL2RE16_V", 1.0]
|
||||
- ["VL2RE32_V", 1.0]
|
||||
- ["VL2RE64_V", 1.0]
|
||||
- ["VL2RE8_V", 1.0]
|
||||
- ["VL4RE16_V", 1.0]
|
||||
- ["VL4RE32_V", 1.0]
|
||||
- ["VL4RE64_V", 1.0]
|
||||
- ["VL4RE8_V", 1.0]
|
||||
- ["VL8RE16_V", 1.0]
|
||||
- ["VL8RE32_V", 1.0]
|
||||
- ["VL8RE64_V", 1.0]
|
||||
- ["VL8RE8_V", 1.0]
|
||||
- ["VLE16FF_V", 1.0]
|
||||
- ["VLE16_V", 1.0]
|
||||
- ["VLE32FF_V", 1.0]
|
||||
- ["VLE32_V", 1.0]
|
||||
- ["VLE64FF_V", 1.0]
|
||||
- ["VLE64_V", 1.0]
|
||||
- ["VLE8FF_V", 1.0]
|
||||
- ["VLE8_V", 1.0]
|
||||
- ["VLM_V", 1.0]
|
||||
- ["VLOXEI16_V", 1.0]
|
||||
- ["VLOXEI32_V", 1.0]
|
||||
- ["VLOXEI64_V", 1.0]
|
||||
- ["VLOXEI8_V", 1.0]
|
||||
- ["VLOXSEG2EI16_V", 1.0]
|
||||
- ["VLOXSEG2EI32_V", 1.0]
|
||||
- ["VLOXSEG2EI64_V", 1.0]
|
||||
- ["VLOXSEG2EI8_V", 1.0]
|
||||
- ["VLOXSEG3EI16_V", 1.0]
|
||||
- ["VLOXSEG3EI32_V", 1.0]
|
||||
- ["VLOXSEG3EI64_V", 1.0]
|
||||
- ["VLOXSEG3EI8_V", 1.0]
|
||||
- ["VLOXSEG4EI16_V", 1.0]
|
||||
- ["VLOXSEG4EI32_V", 1.0]
|
||||
- ["VLOXSEG4EI64_V", 1.0]
|
||||
- ["VLOXSEG4EI8_V", 1.0]
|
||||
- ["VLOXSEG5EI16_V", 1.0]
|
||||
- ["VLOXSEG5EI32_V", 1.0]
|
||||
- ["VLOXSEG5EI64_V", 1.0]
|
||||
- ["VLOXSEG5EI8_V", 1.0]
|
||||
- ["VLOXSEG6EI16_V", 1.0]
|
||||
- ["VLOXSEG6EI32_V", 1.0]
|
||||
- ["VLOXSEG6EI64_V", 1.0]
|
||||
- ["VLOXSEG6EI8_V", 1.0]
|
||||
- ["VLOXSEG7EI16_V", 1.0]
|
||||
- ["VLOXSEG7EI32_V", 1.0]
|
||||
- ["VLOXSEG7EI64_V", 1.0]
|
||||
- ["VLOXSEG7EI8_V", 1.0]
|
||||
- ["VLOXSEG8EI16_V", 1.0]
|
||||
- ["VLOXSEG8EI32_V", 1.0]
|
||||
- ["VLOXSEG8EI64_V", 1.0]
|
||||
- ["VLOXSEG8EI8_V", 1.0]
|
||||
- ["VLSE16_V", 1.0]
|
||||
- ["VLSE32_V", 1.0]
|
||||
- ["VLSE64_V", 1.0]
|
||||
- ["VLSE8_V", 1.0]
|
||||
- ["VLSEG2E16FF_V", 1.0]
|
||||
- ["VLSEG2E16_V", 1.0]
|
||||
- ["VLSEG2E32FF_V", 1.0]
|
||||
- ["VLSEG2E32_V", 1.0]
|
||||
- ["VLSEG2E64FF_V", 1.0]
|
||||
- ["VLSEG2E64_V", 1.0]
|
||||
- ["VLSEG2E8FF_V", 1.0]
|
||||
- ["VLSEG2E8_V", 1.0]
|
||||
- ["VLSEG3E16FF_V", 1.0]
|
||||
- ["VLSEG3E16_V", 1.0]
|
||||
- ["VLSEG3E32FF_V", 1.0]
|
||||
- ["VLSEG3E32_V", 1.0]
|
||||
- ["VLSEG3E64FF_V", 1.0]
|
||||
- ["VLSEG3E64_V", 1.0]
|
||||
- ["VLSEG3E8FF_V", 1.0]
|
||||
- ["VLSEG3E8_V", 1.0]
|
||||
- ["VLSEG4E16FF_V", 1.0]
|
||||
- ["VLSEG4E16_V", 1.0]
|
||||
- ["VLSEG4E32FF_V", 1.0]
|
||||
- ["VLSEG4E32_V", 1.0]
|
||||
- ["VLSEG4E64FF_V", 1.0]
|
||||
- ["VLSEG4E64_V", 1.0]
|
||||
- ["VLSEG4E8FF_V", 1.0]
|
||||
- ["VLSEG4E8_V", 1.0]
|
||||
- ["VLSEG5E16FF_V", 1.0]
|
||||
- ["VLSEG5E16_V", 1.0]
|
||||
- ["VLSEG5E32FF_V", 1.0]
|
||||
- ["VLSEG5E32_V", 1.0]
|
||||
- ["VLSEG5E64FF_V", 1.0]
|
||||
- ["VLSEG5E64_V", 1.0]
|
||||
- ["VLSEG5E8FF_V", 1.0]
|
||||
- ["VLSEG5E8_V", 1.0]
|
||||
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